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RISC-V CPU IP解决方案
芯来 Core Gen
期望频率(MHZ)
使用工艺
生成方式
默认
面积优先
性能优先
CPU类型
N300
NS300
双发射支持
双发射支持
PMP支持
PMP支持
PMP个数
8
16
TEE支持
TEE支持
乘法器选择
单周期乘法器
2周期乘法器
除法器选择
33周期除法器
17周期除法器
B扩展
B扩展
浮点
不支持浮点
单精度
双精度/单精度
DSP
DSP
ILM
ILM
接口:
SRAM
AHBL
ILM大小位宽
DLM
DLM
接口:
SRAM
AHBL
DLM大小位宽(e.g. 8) [13-31]
外部访问ILM/DLM
外部访问ILM/DLM
ICache
ICache
2K
4K
8K
16K
32K
64K
是否有独立的总线给icache使用
ICACHE和ILM共享SRAM
DCache
DCache
2K
4K
8K
16K
32K
64K
Device区域
Device区域
Non-Cacheable区域
Non-Cacheable区域
ECC
ECC
专用外设总线
专用外设总线
快速外设总线
快速外设总线
中断个数
自定义指令接口
自定义指令接口
双核锁步
双核锁步
安全特性
安全存储保护单元
黑盒调试模块
栈指针检测模块
总线数据极化
查看大图